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赛灵思同时推出六大领域优化开发套件FPGACPLD万芳

发布时间:2020-02-14 11:24:44 阅读: 来源:碰焊机厂家

赛灵思同时推出六大领域优化开发套件 - FPGA/CPLD - 电子工程网

此次推出的套件既支持利用 Virtex-6 系列 FPGA 面向高计算强度、高速、高密度 SoC 应用的设计开发,也支持利用 Spartan-6 系列 FPGA 面向注重性能、尺寸、功耗及成本的应用的设计开发。每个套件都充分利用上述两大 FPGA 系列内的重要功能,包括:带有集成PCI Express 端点模块的低功耗高速串行收发器、集成存储器控制器,以及具有前加法器和先进控制功能的高级高性能数字信号处理芯片。

ISE 设计套件 11.4版本对每个套件都提供支持,为Spartan-6 FPGA设计降低25%的运行时间,为之前发布的大型、复杂和高度使用的Virtex-6 SOC设计降低30%的运行时间。

所有套件配套提供可扩展的开发板、全功能的领域专用 IP核、目标参考设计、设计样例、完整的文档和线缆等,使设计人员可立即启动开发工作。经全面验证的目标参考设计是每个套件的核心,专门针对其支持的设计领域进行了精心优化,而且既可按其原样直接使用,也可加以修改扩展后再使用。客户还能获得源代码和仿真文件,用于在设计环境中构建自己的最终应用。

这些套件建立在今年早些时候宣布推出的 Spartan-6 FPGA 和Virtex-6 FPGA 基础评估套件的基础之上,随后赛灵思及其生态合作伙伴还将推出 DSP和市场专用开发套件,如 2009 年11 月已推出的 Virtex-6 FPGA 广播连接套件。 (详情参见:www.xilinx.com/cn/press/V6bck )

连接功能开发

连接开发套件包含目标参考设计,其将 FPGA 内的硬件模块、赛灵思连接 IP 以及赛灵思联盟计划重要成员Northwest Logic公司的IP完美整合在一起,提供全面可扩展的 PCIe 到 XAUI 或千兆位以太网的桥接器。客户可在 Virtex-6 FPGA 套件中选择完全符合 PCIe gen 1 或 gen 2 x1、x2、x4 标准的版本,调整 DMA 设置以优化系统带宽,从外部 DDR3 存储器中读/写数据,并链接到系统环境中的全 XAUI接口。Spartan-6 FPGA 套件帮助设计人员利用完整授权的Northwest Logic DMA引擎IP,将完全符合 PCIe gen 1 标准的接口与千兆位以太网相链接。这两款套件帮助设计人员测量系统带宽,优化设置,以降低主机系统环境的功耗与成本。预先加载的目标参考设计经过精心优化,可展示采用最高运行频率达 250MHz的四个不同时钟域的全功能连接系统。

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